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-- Copyright (C) 1991-2009 Altera Corporation
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-- Your use of Altera Corporation's design tools, logic functions
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-- and other software and tools, and its AMPP partner logic
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-- functions, and any output files from any of the foregoing
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-- (including device programming or simulation files), and any
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-- associated documentation or information are expressly subject
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-- to the terms and conditions of the Altera Program License
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-- Subscription Agreement, Altera MegaCore Function License
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-- Agreement, or other applicable license agreement, including,
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-- without limitation, that your use is for the sole purpose of
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-- programming logic devices manufactured by Altera and sold by
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-- Altera or its authorized distributors. Please refer to the
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-- applicable agreement for further details.
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--
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-- This is a Quartus II output file. It is for reporting purposes only, and is
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-- not intended for use as a Quartus II input file. This file cannot be used
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-- to make Quartus II pin assignments - for instructions on how to make pin
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-- assignments, please see Quartus II help.
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-- NC : No Connect. This pin has no internal connection to the device.
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-- DNU : Do Not Use. This pin MUST NOT be connected.
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-- VCCINT : Dedicated power pin, which MUST be connected to VCC (1.2V).
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-- VCCIO : Dedicated power pin, which MUST be connected to VCC
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-- of its bank.
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-- Bank 1: 3.3V
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-- Bank 2: 3.3V
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-- Bank 3: 3.3V
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-- Bank 4: 3.3V
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-- GND : Dedicated ground pin. Dedicated GND pins MUST be connected to GND.
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-- It can also be used to report unused dedicated pins. The connection
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-- on the board for unused dedicated pins depends on whether this will
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-- be used in a future design. One example is device migration. When
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-- using device migration, refer to the device pin-tables. If it is a
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-- GND pin in the pin table or if it will not be used in a future design
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-- for another purpose the it MUST be connected to GND. If it is an unused
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-- dedicated pin, then it can be connected to a valid signal on the board
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-- (low, high, or toggling) if that signal is required for a different
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-- revision of the design.
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-- GND+ : Unused input pin. It can also be used to report unused dual-purpose pins.
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-- This pin should be connected to GND. It may also be connected to a
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-- valid signal on the board (low, high, or toggling) if that signal
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-- is required for a different revision of the design.
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-- GND* : Unused I/O pin. For transceiver I/O banks (Bank 13, 14, 15, 16 and 17),
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-- connect each pin marked GND* either individually through a 10k Ohm resistor
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-- to GND or tie all pins together and connect through a single 10k Ohm resistor
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-- to GND.
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-- For non-transceiver I/O banks, connect each pin marked GND* directly to GND
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-- or leave it unconnected.
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-- RESERVED : Unused I/O pin, which MUST be left unconnected.
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-- RESERVED_INPUT : Pin is tri-stated and should be connected to the board.
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-- RESERVED_INPUT_WITH_WEAK_PULLUP : Pin is tri-stated with internal weak pull-up resistor.
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-- RESERVED_INPUT_WITH_BUS_HOLD : Pin is tri-stated with bus-hold circuitry.
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-- RESERVED_OUTPUT_DRIVEN_HIGH : Pin is output driven high.
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-- Pin directions (input, output or bidir) are based on device operating in user mode.
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Quartus II Version 9.0 Build 235 06/17/2009 Service Pack 2 SJ Web Edition
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CHIP "adder_8b" ASSIGNED TO AN: EP2C8Q208C8
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Pin Name/Usage : Location : Dir. : I/O Standard : Voltage : I/O Bank : User Assignment
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~ASDO~ / RESERVED_INPUT_WITH_WEAK_PULLUP : 1 : input : 3.3-V LVTTL : : 1 : N
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~nCSO~ / RESERVED_INPUT_WITH_WEAK_PULLUP : 2 : input : 3.3-V LVTTL : : 1 : N
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|
GND* : 3 : : : : 1 :
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|
GND* : 4 : : : : 1 :
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|
A7 : 5 : input : 3.3-V LVTTL : : 1 : N
|
|
S7 : 6 : output : 3.3-V LVTTL : : 1 : N
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|
VCCIO1 : 7 : power : : 3.3V : 1 :
|
|
GND* : 8 : : : : 1 :
|
|
GND : 9 : gnd : : : :
|
|
B6 : 10 : input : 3.3-V LVTTL : : 1 : N
|
|
B7 : 11 : input : 3.3-V LVTTL : : 1 : N
|
|
S6 : 12 : output : 3.3-V LVTTL : : 1 : N
|
|
A6 : 13 : input : 3.3-V LVTTL : : 1 : N
|
|
B5 : 14 : input : 3.3-V LVTTL : : 1 : N
|
|
GND* : 15 : : : : 1 :
|
|
TDO : 16 : output : : : 1 :
|
|
TMS : 17 : input : : : 1 :
|
|
TCK : 18 : input : : : 1 :
|
|
TDI : 19 : input : : : 1 :
|
|
DATA0 : 20 : input : : : 1 :
|
|
DCLK : 21 : : : : 1 :
|
|
nCE : 22 : : : : 1 :
|
|
A2 : 23 : input : 3.3-V LVTTL : : 1 : N
|
|
A0 : 24 : input : 3.3-V LVTTL : : 1 : N
|
|
GND : 25 : gnd : : : :
|
|
nCONFIG : 26 : : : : 1 :
|
|
CI : 27 : input : 3.3-V LVTTL : : 1 : N
|
|
B0 : 28 : input : 3.3-V LVTTL : : 1 : N
|
|
VCCIO1 : 29 : power : : 3.3V : 1 :
|
|
B2 : 30 : input : 3.3-V LVTTL : : 1 : N
|
|
S3 : 31 : output : 3.3-V LVTTL : : 1 : N
|
|
VCCINT : 32 : power : : 1.2V : :
|
|
GND* : 33 : : : : 1 :
|
|
S1 : 34 : output : 3.3-V LVTTL : : 1 : N
|
|
S5 : 35 : output : 3.3-V LVTTL : : 1 : N
|
|
GND : 36 : gnd : : : :
|
|
S4 : 37 : output : 3.3-V LVTTL : : 1 : N
|
|
GND : 38 : gnd : : : :
|
|
B3 : 39 : input : 3.3-V LVTTL : : 1 : N
|
|
A3 : 40 : input : 3.3-V LVTTL : : 1 : N
|
|
A4 : 41 : input : 3.3-V LVTTL : : 1 : N
|
|
VCCIO1 : 42 : power : : 3.3V : 1 :
|
|
GND* : 43 : : : : 1 :
|
|
GND* : 44 : : : : 1 :
|
|
GND* : 45 : : : : 1 :
|
|
GND* : 46 : : : : 1 :
|
|
GND* : 47 : : : : 1 :
|
|
GND* : 48 : : : : 1 :
|
|
GND : 49 : gnd : : : :
|
|
GND_PLL1 : 50 : gnd : : : :
|
|
VCCD_PLL1 : 51 : power : : 1.2V : :
|
|
GND_PLL1 : 52 : gnd : : : :
|
|
VCCA_PLL1 : 53 : power : : 1.2V : :
|
|
GNDA_PLL1 : 54 : gnd : : : :
|
|
GND : 55 : gnd : : : :
|
|
GND* : 56 : : : : 4 :
|
|
A1 : 57 : input : 3.3-V LVTTL : : 4 : N
|
|
CO : 58 : output : 3.3-V LVTTL : : 4 : N
|
|
GND* : 59 : : : : 4 :
|
|
B1 : 60 : input : 3.3-V LVTTL : : 4 : N
|
|
GND* : 61 : : : : 4 :
|
|
VCCIO4 : 62 : power : : 3.3V : 4 :
|
|
GND* : 63 : : : : 4 :
|
|
GND* : 64 : : : : 4 :
|
|
GND : 65 : gnd : : : :
|
|
VCCINT : 66 : power : : 1.2V : :
|
|
GND* : 67 : : : : 4 :
|
|
GND* : 68 : : : : 4 :
|
|
GND* : 69 : : : : 4 :
|
|
GND* : 70 : : : : 4 :
|
|
VCCIO4 : 71 : power : : 3.3V : 4 :
|
|
GND* : 72 : : : : 4 :
|
|
GND : 73 : gnd : : : :
|
|
GND* : 74 : : : : 4 :
|
|
GND* : 75 : : : : 4 :
|
|
GND* : 76 : : : : 4 :
|
|
GND* : 77 : : : : 4 :
|
|
GND : 78 : gnd : : : :
|
|
VCCINT : 79 : power : : 1.2V : :
|
|
GND* : 80 : : : : 4 :
|
|
GND* : 81 : : : : 4 :
|
|
GND* : 82 : : : : 4 :
|
|
VCCIO4 : 83 : power : : 3.3V : 4 :
|
|
GND* : 84 : : : : 4 :
|
|
GND : 85 : gnd : : : :
|
|
GND* : 86 : : : : 4 :
|
|
GND* : 87 : : : : 4 :
|
|
GND* : 88 : : : : 4 :
|
|
GND* : 89 : : : : 4 :
|
|
GND* : 90 : : : : 4 :
|
|
VCCIO4 : 91 : power : : 3.3V : 4 :
|
|
GND* : 92 : : : : 4 :
|
|
GND : 93 : gnd : : : :
|
|
GND* : 94 : : : : 4 :
|
|
GND* : 95 : : : : 4 :
|
|
GND* : 96 : : : : 4 :
|
|
GND* : 97 : : : : 4 :
|
|
VCCIO4 : 98 : power : : 3.3V : 4 :
|
|
GND* : 99 : : : : 4 :
|
|
GND : 100 : gnd : : : :
|
|
GND* : 101 : : : : 4 :
|
|
S0 : 102 : output : 3.3-V LVTTL : : 4 : N
|
|
GND* : 103 : : : : 4 :
|
|
GND* : 104 : : : : 4 :
|
|
GND* : 105 : : : : 3 :
|
|
GND* : 106 : : : : 3 :
|
|
GND* : 107 : : : : 3 :
|
|
~LVDS54p/nCEO~ : 108 : output : 3.3-V LVTTL : : 3 : N
|
|
VCCIO3 : 109 : power : : 3.3V : 3 :
|
|
GND* : 110 : : : : 3 :
|
|
GND : 111 : gnd : : : :
|
|
GND* : 112 : : : : 3 :
|
|
GND* : 113 : : : : 3 :
|
|
GND* : 114 : : : : 3 :
|
|
GND* : 115 : : : : 3 :
|
|
GND* : 116 : : : : 3 :
|
|
GND* : 117 : : : : 3 :
|
|
S2 : 118 : output : 3.3-V LVTTL : : 3 : N
|
|
GND : 119 : gnd : : : :
|
|
VCCINT : 120 : power : : 1.2V : :
|
|
nSTATUS : 121 : : : : 3 :
|
|
VCCIO3 : 122 : power : : 3.3V : 3 :
|
|
CONF_DONE : 123 : : : : 3 :
|
|
GND : 124 : gnd : : : :
|
|
MSEL1 : 125 : : : : 3 :
|
|
MSEL0 : 126 : : : : 3 :
|
|
GND* : 127 : : : : 3 :
|
|
GND* : 128 : : : : 3 :
|
|
GND+ : 129 : : : : 3 :
|
|
GND+ : 130 : : : : 3 :
|
|
GND+ : 131 : : : : 3 :
|
|
GND+ : 132 : : : : 3 :
|
|
GND* : 133 : : : : 3 :
|
|
GND* : 134 : : : : 3 :
|
|
GND* : 135 : : : : 3 :
|
|
VCCIO3 : 136 : power : : 3.3V : 3 :
|
|
GND* : 137 : : : : 3 :
|
|
GND* : 138 : : : : 3 :
|
|
GND* : 139 : : : : 3 :
|
|
GND : 140 : gnd : : : :
|
|
GND* : 141 : : : : 3 :
|
|
GND* : 142 : : : : 3 :
|
|
GND* : 143 : : : : 3 :
|
|
GND* : 144 : : : : 3 :
|
|
GND* : 145 : : : : 3 :
|
|
GND* : 146 : : : : 3 :
|
|
GND* : 147 : : : : 3 :
|
|
VCCIO3 : 148 : power : : 3.3V : 3 :
|
|
GND* : 149 : : : : 3 :
|
|
A5 : 150 : input : 3.3-V LVTTL : : 3 : N
|
|
GND* : 151 : : : : 3 :
|
|
GND* : 152 : : : : 3 :
|
|
GND : 153 : gnd : : : :
|
|
GND_PLL2 : 154 : gnd : : : :
|
|
VCCD_PLL2 : 155 : power : : 1.2V : :
|
|
GND_PLL2 : 156 : gnd : : : :
|
|
VCCA_PLL2 : 157 : power : : 1.2V : :
|
|
GNDA_PLL2 : 158 : gnd : : : :
|
|
GND : 159 : gnd : : : :
|
|
GND* : 160 : : : : 2 :
|
|
GND* : 161 : : : : 2 :
|
|
GND* : 162 : : : : 2 :
|
|
GND* : 163 : : : : 2 :
|
|
GND* : 164 : : : : 2 :
|
|
GND* : 165 : : : : 2 :
|
|
VCCIO2 : 166 : power : : 3.3V : 2 :
|
|
GND : 167 : gnd : : : :
|
|
GND* : 168 : : : : 2 :
|
|
GND* : 169 : : : : 2 :
|
|
GND* : 170 : : : : 2 :
|
|
GND* : 171 : : : : 2 :
|
|
VCCIO2 : 172 : power : : 3.3V : 2 :
|
|
GND* : 173 : : : : 2 :
|
|
GND : 174 : gnd : : : :
|
|
GND* : 175 : : : : 2 :
|
|
GND* : 176 : : : : 2 :
|
|
GND : 177 : gnd : : : :
|
|
VCCINT : 178 : power : : 1.2V : :
|
|
GND* : 179 : : : : 2 :
|
|
GND* : 180 : : : : 2 :
|
|
GND* : 181 : : : : 2 :
|
|
GND* : 182 : : : : 2 :
|
|
VCCIO2 : 183 : power : : 3.3V : 2 :
|
|
GND : 184 : gnd : : : :
|
|
GND* : 185 : : : : 2 :
|
|
GND : 186 : gnd : : : :
|
|
GND* : 187 : : : : 2 :
|
|
GND* : 188 : : : : 2 :
|
|
GND* : 189 : : : : 2 :
|
|
VCCINT : 190 : power : : 1.2V : :
|
|
GND* : 191 : : : : 2 :
|
|
GND* : 192 : : : : 2 :
|
|
GND* : 193 : : : : 2 :
|
|
VCCIO2 : 194 : power : : 3.3V : 2 :
|
|
GND* : 195 : : : : 2 :
|
|
GND : 196 : gnd : : : :
|
|
GND* : 197 : : : : 2 :
|
|
GND* : 198 : : : : 2 :
|
|
GND* : 199 : : : : 2 :
|
|
GND* : 200 : : : : 2 :
|
|
GND* : 201 : : : : 2 :
|
|
VCCIO2 : 202 : power : : 3.3V : 2 :
|
|
GND* : 203 : : : : 2 :
|
|
GND : 204 : gnd : : : :
|
|
GND* : 205 : : : : 2 :
|
|
GND* : 206 : : : : 2 :
|
|
B4 : 207 : input : 3.3-V LVTTL : : 2 : N
|
|
GND* : 208 : : : : 2 :
|